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path: root/include/dt-bindings/clock/qcom,sdx75-gcc.h
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-rw-r--r--include/dt-bindings/clock/qcom,sdx75-gcc.h193
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diff --git a/include/dt-bindings/clock/qcom,sdx75-gcc.h b/include/dt-bindings/clock/qcom,sdx75-gcc.h
deleted file mode 100644
index a470e8c4fd4..00000000000
--- a/include/dt-bindings/clock/qcom,sdx75-gcc.h
+++ /dev/null
@@ -1,193 +0,0 @@
-/* SPDX-License-Identifier: (GPL-2.0-only OR BSD-2-Clause) */
-/*
- * Copyright (c) 2022-2023, Qualcomm Innovation Center, Inc. All rights reserved.
- */
-
-#ifndef _DT_BINDINGS_CLK_QCOM_GCC_SDX75_H
-#define _DT_BINDINGS_CLK_QCOM_GCC_SDX75_H
-
-/* GCC clocks */
-#define GPLL0 0
-#define GPLL0_OUT_EVEN 1
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-#define GPLL5 3
-#define GPLL6 4
-#define GPLL8 5
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-#define GCC_USB3_PRIM_CLKREF_EN 140
-#define GCC_USB_PHY_CFG_AHB2PHY_CLK 141
-#define GCC_XO_PCIE_LINK_CLK 142
-
-/* GCC power domains */
-#define GCC_EMAC0_GDSC 0
-#define GCC_EMAC1_GDSC 1
-#define GCC_PCIE_1_GDSC 2
-#define GCC_PCIE_1_PHY_GDSC 3
-#define GCC_PCIE_2_GDSC 4
-#define GCC_PCIE_2_PHY_GDSC 5
-#define GCC_PCIE_GDSC 6
-#define GCC_PCIE_PHY_GDSC 7
-#define GCC_USB30_GDSC 8
-#define GCC_USB3_PHY_GDSC 9
-
-/* GCC resets */
-#define GCC_EMAC0_BCR 0
-#define GCC_EMAC1_BCR 1
-#define GCC_EMMC_BCR 2
-#define GCC_PCIE_1_BCR 3
-#define GCC_PCIE_1_LINK_DOWN_BCR 4
-#define GCC_PCIE_1_NOCSR_COM_PHY_BCR 5
-#define GCC_PCIE_1_PHY_BCR 6
-#define GCC_PCIE_2_BCR 7
-#define GCC_PCIE_2_LINK_DOWN_BCR 8
-#define GCC_PCIE_2_NOCSR_COM_PHY_BCR 9
-#define GCC_PCIE_2_PHY_BCR 10
-#define GCC_PCIE_BCR 11
-#define GCC_PCIE_LINK_DOWN_BCR 12
-#define GCC_PCIE_NOCSR_COM_PHY_BCR 13
-#define GCC_PCIE_PHY_BCR 14
-#define GCC_PCIE_PHY_CFG_AHB_BCR 15
-#define GCC_PCIE_PHY_COM_BCR 16
-#define GCC_PCIE_PHY_NOCSR_COM_PHY_BCR 17
-#define GCC_QUSB2PHY_BCR 18
-#define GCC_TCSR_PCIE_BCR 19
-#define GCC_USB30_BCR 20
-#define GCC_USB3_PHY_BCR 21
-#define GCC_USB3PHY_PHY_BCR 22
-#define GCC_USB_PHY_CFG_AHB2PHY_BCR 23
-#define GCC_EMAC0_RGMII_CLK_ARES 24
-
-#endif